pan/bi: Don't hide SCHED_ADD inside HI_LATENCY
It makes bitwise property checking annoying. Signed-off-by: Alyssa Rosenzweig <alyssa.rosenzweig@collabora.com> Part-of: <https://gitlab.freedesktop.org/mesa/mesa/-/merge_requests/4242>
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Marge Bot
parent
d797822d31
commit
e323df05a9
@@ -28,29 +28,29 @@
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unsigned bi_class_props[BI_NUM_CLASSES] = {
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[BI_ADD] = BI_GENERIC | BI_MODS | BI_SCHED_ALL,
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[BI_ATEST] = BI_SCHED_HI_LATENCY | BI_VECTOR,
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[BI_BRANCH] = BI_SCHED_HI_LATENCY,
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[BI_ATEST] = BI_SCHED_HI_LATENCY | BI_SCHED_ADD | BI_VECTOR,
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[BI_BRANCH] = BI_SCHED_HI_LATENCY | BI_SCHED_ADD,
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[BI_CMP] = BI_GENERIC | BI_MODS | BI_SCHED_ALL,
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[BI_BLEND] = BI_SCHED_HI_LATENCY | BI_VECTOR,
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[BI_BLEND] = BI_SCHED_HI_LATENCY | BI_SCHED_ADD | BI_VECTOR,
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[BI_BITWISE] = BI_GENERIC | BI_SCHED_ALL,
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[BI_CONVERT] = BI_SCHED_ALL | BI_SWIZZLABLE,
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[BI_CSEL] = BI_SCHED_FMA,
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[BI_DISCARD] = BI_SCHED_HI_LATENCY,
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[BI_DISCARD] = BI_SCHED_HI_LATENCY | BI_SCHED_ADD,
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[BI_FMA] = BI_ROUNDMODE | BI_SCHED_FMA,
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[BI_FREXP] = BI_SCHED_ALL,
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[BI_ISUB] = BI_GENERIC | BI_SCHED_ALL,
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[BI_LOAD] = BI_SCHED_HI_LATENCY | BI_VECTOR | BI_DATA_REG_DEST,
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[BI_LOAD_UNIFORM] = BI_SCHED_HI_LATENCY | BI_VECTOR | BI_DATA_REG_DEST,
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[BI_LOAD_ATTR] = BI_SCHED_HI_LATENCY | BI_VECTOR | BI_DATA_REG_DEST,
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[BI_LOAD_VAR] = BI_SCHED_HI_LATENCY | BI_VECTOR | BI_DATA_REG_DEST,
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[BI_LOAD_VAR_ADDRESS] = BI_SCHED_HI_LATENCY,
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[BI_LOAD] = BI_SCHED_HI_LATENCY | BI_SCHED_ADD | BI_VECTOR | BI_DATA_REG_DEST,
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[BI_LOAD_UNIFORM] = BI_SCHED_HI_LATENCY | BI_SCHED_ADD | BI_VECTOR | BI_DATA_REG_DEST,
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[BI_LOAD_ATTR] = BI_SCHED_HI_LATENCY | BI_SCHED_ADD | BI_VECTOR | BI_DATA_REG_DEST,
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[BI_LOAD_VAR] = BI_SCHED_HI_LATENCY | BI_SCHED_ADD | BI_VECTOR | BI_DATA_REG_DEST,
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[BI_LOAD_VAR_ADDRESS] = BI_SCHED_HI_LATENCY | BI_SCHED_ADD,
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[BI_MINMAX] = BI_GENERIC | BI_SCHED_ALL,
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[BI_MOV] = BI_MODS | BI_SCHED_ALL,
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[BI_SHIFT] = BI_SCHED_ALL,
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[BI_STORE] = BI_SCHED_HI_LATENCY | BI_VECTOR | BI_DATA_REG_SRC,
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[BI_STORE_VAR] = BI_SCHED_HI_LATENCY | BI_VECTOR | BI_DATA_REG_SRC,
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[BI_STORE] = BI_SCHED_HI_LATENCY | BI_SCHED_ADD | BI_VECTOR | BI_DATA_REG_SRC,
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[BI_STORE_VAR] = BI_SCHED_HI_LATENCY | BI_SCHED_ADD | BI_VECTOR | BI_DATA_REG_SRC,
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[BI_SPECIAL] = BI_SCHED_ADD | BI_SCHED_SLOW,
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[BI_SWIZZLE] = BI_SCHED_ALL | BI_SWIZZLABLE,
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[BI_TEX] = BI_SCHED_HI_LATENCY | BI_VECTOR,
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[BI_TEX] = BI_SCHED_HI_LATENCY | BI_SCHED_ADD | BI_VECTOR,
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[BI_ROUND] = BI_GENERIC | BI_ROUNDMODE | BI_SCHED_ALL,
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};
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@@ -108,7 +108,7 @@ extern unsigned bi_class_props[BI_NUM_CLASSES];
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/* For scheduling purposes this is a high latency instruction and must be at
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* the end of a clause. Implies ADD */
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#define BI_SCHED_HI_LATENCY ((1 << 7) | BI_SCHED_ADD)
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#define BI_SCHED_HI_LATENCY (1 << 7)
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/* Intrinsic is vectorized and should read 4 components regardless of writemask */
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#define BI_VECTOR (1 << 8)
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